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ispClock5300S | Lattice 电源和时钟
ispClock5300S是一种适用于时钟分配应用的在系统可编程零延时通用扇出缓冲器。ispClock5300S系列提供4至20个单端超低相偏的输出。

特性

四种工作配置
零延时缓冲器
零延时及非零延时缓冲器
双非零延时缓冲器
带有输出分频器的非零延时缓冲器
8MHz至267MHz的输入/输出工作频率
低输出至输出相偏(<100ps)
低峰-峰抖动 (< 70 ps)
多达20个可编程扇出缓冲器
可编程单端输出标准并允许单独控制
LVTTL, LVCMOS, HSTL, eHSTL, SSTL
可编程的输出阻抗
40至70Ω ,以5Ω为增量
可编程的回转率
多达10个带有单独VCCO 和GND的块
1.5V, 1.8V, 2.5V, 3.3V
完全集成的高性能的PLL
可编程的锁定检测
三个“2次幂”的输出分频器(5-位)
可编程的片上环路滤波器
兼容扩频时钟
每个输出具有可编程的相位调节(相偏)功能
8种设置;最小步长156ps
锁定到VCO频率
 
高达+/- 5ns的相偏范围
粗、细调节模式
多达三个时钟频率域
灵活的时钟参考和外部反馈输入
可编程的单端或差分输入参考标准
LVTTL, LVCMOS, SSTL, HSTL, LVDS, LVPECL, 差分HSTL, 差分SSTL
时钟A/B选择多路复用器
可编程的反馈标准
LVTTL, LVCMOS, SSTL, HSTL
可编程终端
所有输入和输出兼容热插拔
支持完整的在系统JTAG边界扫描测试
超强的抗电源噪声能力
商业的(0至70°C)和工业的(-40至85°C)温度范围
48-pin和64-pin的TQFP封装
应用
电路板公共时钟分配
基于PLL的频率生成
高扇出时钟缓冲器
零延时时钟缓冲器
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Lattice(莱迪思)官网发布的行业动态(2024年4月14日更新)
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